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HPEC应用子程序线程推测并行性实验分析

消耗积分:0 | 格式:rar | 大小:1.68 MB | 2021-03-30

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　　线程级推测（TLS）技术的有效运用可提高多核芯片的硬件资源利用率，其已在多种串行应用的自动并行化工作中取得了较好效果，但目前缺乏对HPEC应用子程序级线程推测方面的有效分析。针对该问题，设计子程序级推测的剖析机制及核心数据结构，选取HPEC中7个具有代表性的程序，挖掘其子程序级的最大潜在并行性并结合线程粒度、并行覆盖率、子程序调用次数、数据依赖及源码，对程序的加速比进行分析。实验结果表明， fdirsvd、db和ga程序的加速比在2.2331， tdfir程序的加速效果最好，加速比达到221.78，对于包含多次非重度数据依赖子程序调用的应用，更适合采用子程序级TLS技术测试其并行性。

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