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FPGA视频教程之为什么Verilog能支持大型设计的详细资料说明

消耗积分:0 | 格式:rar | 大小:6.05 MB | 2019-03-27

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　　为什么Verilog能支持大型设计

　　Verilog语法支持多层次多模块设计：-用、include宏指令可以在一个模块中包含多个模块;

　　在一个模块中可以用实例调用别的模块中定义的电路结构，构成多层次模块：

　　在一个模块中可以用多个任务和函数来表达复杂的状态机和结构;

　　一个设计项目往往由一个顶层测试模块和多个可综合模块和若千个外围接口模块构成。

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